全志科技申请 SOC 芯片测试相关专利，提升芯片测试效率

金融界 2024 年 8 月 4 日消息，天眼查知识产权信息显示，珠海全志科技股份有限公司申请一项名为“SOC 芯片测试方法、装置、设备、存储介质“，公开号 CN202410476872.9，申请日期为 2024 年 4 月。

专利摘要显示，本申请公开了一种 SOC 芯片测试方法、装置、设备、存储介质，方法包括：待测 SOC 芯片发送 boot 成功指令至 ATE 测试机，ATE 测试机将测试命令发给待测 SOC 芯片；当第一 CPU 内核接收到测试命令，为各个第二 CPU 内核分配目标资源；第一 CPU 内核启动各个第二 CPU 内核，并控制各个第二 CPU 内核基于目标资源进行测试，得到子测试结果；第一 CPU 内核检测各个第二 CPU 内核的测试状态信息，获取各个子测试结果，将测试状态信息和测试结果发给 ATE 测试机；ATE 测试机基于子测试结果生成目标芯片测试结果。本申请能够实现待测 SOC 芯片多核同时工作，同一时间并行测试不同的测试项，相比单核测试的方案，提升芯片测试效率。

本文源自金融界

全志科技申请多核异构芯片系统的休眠和唤醒专利，减少功耗提高电池使用寿命

金融界 2024 年 7 月 28 日消息，天眼查知识产权信息显示，珠海全志科技股份有限公司申请一项名为“多核异构芯片系统的休眠和唤醒方法、设备及介质“，公开号 CN202410450482.4，申请日期为 2024 年 4 月。

专利摘要显示，本发明公开了一种多核异构芯片系统的休眠和唤醒方法、设备及介质，方法包括：主核向子核发送第一休眠信息；主核接收子核的休眠反馈信息；主核接管子核的唤醒中断，并对普通外设进行一级休眠，对关键外设进行二级休眠；主核对唤醒资源进行检查得到检查结果；主核根据检查结果确定唤醒子核或继续休眠；在主核接收到唤醒源中断的情况下，唤醒关键外设进入一级休眠状态；主核进行投票结果检查确定继续休眠或唤醒整个系统。通过分级唤醒和投票结果检查进行子核和主核的唤醒和休眠，从而在多核异构芯片休眠和唤醒时减少功耗，提高电池的使用寿命，可广泛应用于多核异构技术领域。

本文源自金融界

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